这是第一次在博客园写随笔，感觉不错
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代码结构
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systemverilog笔记
变量类型变量名
状态数
是否带符号
比特数logic
4
无
1bit
2
无
1byte
2
有
8shortint
2
有
16int
2
有
32longint
2
有
64integer
4
有
32time
4
无
64$isunknown(表达式)：在表达式任意位出现X或者Z时返回1。
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$size(数组)会返回
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