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晶体管二进制，只显示两种信号状态，电路连接为真，电路断开为假，成千上万的晶体管中同时多状态容易出错 布尔提出逻辑运算：输入真与假，对输入进行not，and，or的运算，产生输出 晶体管控制线通电，将控制线作为input，来电一极连接导出线作为output，控制线通电on电流可以从晶体管线路贯穿走而不从上极连线走掉off，晶体管控制线不通电off，电流从上级连线走掉on而不去下极，实现not否定逻辑 两个晶体管串联实现and，都真控制线都通电才能输出电流得到真，一个假控制线未通电，电流就走不出去 两个并联实现or，一个控制线通电就能走出去，有一个真就是真 xor必须一真一假输出才能为真。实现较为麻烦，需要用上面and-not与or串联最后导出到and中得到最后信号
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03 布尔逻辑与逻辑门
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课程地址：https://pdos.csail.mit.edu/6.S081/2020/schedule.html
Lab 地址：https://pdos.csail.mit.edu/6.S081/2020/labs/pgtbl.html
我的代码地址：https://github.com/Amroning/MIT6.S081/tree/pgtbl
相关翻译：http://xv6.dgs.zone/labs/requirements/lab3.html
参考博客…
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